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[架构之路-20]:目标系统 - 硬件平台 - 嵌入式系统硬件电路基础:架构、设计流程、总线、外设、基本电路、编码

   日期:2025-01-03     作者:hvaqj    caijiyuan   评论:0    移动:https://sicmodule.kub2b.com/mobile/news/15255.html
核心提示:PCIe总线规范总线频率单Lane的峰值带宽编码方式吞吐量x1x4x8x161.x1.25GHz2.5GT/s8/10b编码250MB/s1GB/s2GB/s4GB/s2.x2.5GHz5GT/
PCIe总线规范总线频率单Lane的峰值带宽编码方式吞吐量x1x4x8x161.x1.25GHz2.5GT/s8/10b编码250MB/s1GB/s2GB/s4GB/s2.x2.5GHz5GT/s8/10b编码500MB/s2GB/s4GB/s8GB/s3.x4GHz8GT/s128/130b编码984.6MB/s3.938GB/s7.877GB/s15.754GB/s4.x8GHz16GT/s128/130b编码1.969GB/s7.877GB/s15.754GB/s31.508GB/s5.x16GHz32 or 25GT/s128/130b编码3.9 or 3.08GB/s15.8 or 12.3GB/s31.5 or 24.6GB/s63.0 or 49.2GB/s
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